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FPGA項目實戰(zhàn)系列課程－－圖形圖像處理應用方向

課程目標

　　通過本期培訓使學員能夠精通基于FPGA硬件設計方法，運用verilog語言設計JPEG編碼器和H.264數(shù)據(jù)壓縮處理模塊，在掌握HDL硬件設計基本技巧后，對圖像視頻處理有深刻的認識。同時對ASIC設計有一定的了解。

入學要求

理工科類大專以上學歷;喜歡并有志投身于IT事業(yè);具備一定硬件知識;了解Verilog HDL硬件描述語言。

班級規(guī)模及環(huán)境

為了保證培訓效果，增加互動環(huán)節(jié)，我們堅持小班授課，每期報名人數(shù)限3到5人，多余人員安排到下一期進行。

上課時間和上課地點

上課地點：【上海】：同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院【北京分部】：北京中山/福鑫大樓【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路）【成都分部】：領館區(qū)1號（中和大道）【沈陽分部】：沈陽理工大學/六宅臻品【鄭州分部】：鄭州大學/錦華大廈【石家莊分部】：河北科技大學/瑞景大廈【廣州分部】：廣糧大廈【西安分部】：云峰大廈
近開課時間(周末班/連續(xù)班/晚班）：圖像處理開班時間：2025年8月18日..用心服務..........--即將開課--........................

學時和學費

　    ◆課時：共5天，36個學時

        ◆外地學員：代理安排食宿（需提前預定） ☆注重質(zhì)量 ☆邊講邊練
        ☆合格學員免費推薦工作

新優(yōu)惠

◆團體報名優(yōu)惠措施：兩人95折優(yōu)惠，三人或三人以上9折優(yōu)惠

質(zhì)量保障

        1、培訓過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、培訓結束后,培訓老師留給學員手機和Email,免費提供半年的技術支持，充分保證培訓后出效果；
        3、培訓合格學員可享受免費推薦就業(yè)機會。。專注高端培訓13年，曙海提供的證書得到本行業(yè)的廣泛認可，學員的能力得到大家的認同，受到用人單位的廣泛贊譽。

課程大綱

第一部分 JPEG2000 FPGA設計理論與實踐

1. JPEG標準概述

1.1 圖象技術基礎
1.2 YUV與RGB的區(qū)別
1.3 JPEG標準框架

2. JPEG DCT模塊概述與實踐
2.1 之字掃描原理與實現(xiàn)
2.2 8X8的變換原理
2.3 DCT余弦變換的實現(xiàn)與調(diào)試

3. JPEG 量化模塊概述與實踐
3.1 量化的作用和原理
3.2 對量化表系數(shù)的處理和應用
3.3 量化運算的實現(xiàn)

4. JPEG 熵編碼模塊概述與實踐
4.1 Huffman編碼原理
4.2 Huffman編碼的verilog實現(xiàn)與仿真

5. JPEG 總體設計與仿真
5.1 JPEG2000編碼的verilog總體實現(xiàn)與仿真
5.2 設計下載與chipscope調(diào)試

第二部分 H.264視頻處理 FPGA 設計理論與實踐

1. H.264標準學習與研究

1.1 運動圖象處理的基本技術
1.2 H.264框架結構

2. H.264中圖像預處理De-interlace HDL設計實踐
2.1 FIR濾波原理
2.2 De-interlace查值處理的verilog代碼實現(xiàn)與調(diào)試

3. H.264中圖像預處理中值濾波 HDL 設計實踐
3.1 圖像預處理中的高斯白噪聲的處理原理
3.2 3X3中值濾波處理的verilog實現(xiàn)與仿真