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　　　　　　　　　　　　SOC/ASIC設(shè)計培訓(xùn)班
   入學(xué)要求

        學(xué)員學(xué)習(xí)本課程應(yīng)具備下列基礎(chǔ)知識：
        ◆ 有數(shù)字電路設(shè)計和硬件描述語言的基礎(chǔ)或自學(xué)過相關(guān)課程。
現(xiàn)場面授
   教學(xué)優(yōu)勢

　 曙海教育的數(shù)字集成電路設(shè)計課程培養(yǎng)了大批受企業(yè)歡迎的工程師。大批企業(yè)和曙海
建立了良好的合作關(guān)系。曙海教育的數(shù)字集成電路設(shè)計課程在業(yè)內(nèi)有著響亮的知名度。

　 本課程，秉承12年積累的教學(xué)品質(zhì)，以IC項目實現(xiàn)為導(dǎo)向,老師將會與您分享數(shù)字芯片設(shè)計的全流程以及Synopsy和Cadence公司EDA工具的綜合使用經(jīng)驗、技巧。

　 本課程，以實戰(zhàn)貫穿始終，讓您絕對受益匪淺！
   班級規(guī)模及環(huán)境--熱線:4008699035 手機:15921673576/13918613812( 微信同號)
       堅持小班授課，為保證培訓(xùn)效果，增加互動環(huán)節(jié)，每期人數(shù)限3到5人。
   上課時間和地點
上課地點：【上海】：同濟大學(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院 【北京分部】：北京中山/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領(lǐng)館區(qū)1號（中和大道） 【沈陽分部】：沈陽理工大學(xué)/六宅臻品 【鄭州分部】：鄭州大學(xué)/錦華大廈 【石家莊分部】：河北科技大學(xué)/瑞景大廈 【廣州分部】：廣糧大廈 【西安分部】：協(xié)同大廈
近開課時間(周末班/連續(xù)班/晚班）： SOC/ASIC設(shè)計培訓(xùn)班：2025年8月18日..用心服務(wù)..........--即將開課--........................(歡迎您垂詢，視教育質(zhì)量為生命！)
   實驗設(shè)備
　    ☆資深工程師授課

        
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   師資團隊
【趙老師】

大規(guī)模集成電路設(shè)計專家，10多年超大規(guī)模電路SOC芯片設(shè)計和版圖設(shè)計經(jīng)驗，參與過DSP、GPU、DTV、WIFI、手機芯片、物聯(lián)網(wǎng)芯片等芯片的研發(fā)。精通CMOS工藝流程、版圖設(shè)計和布局布線，精通SOC芯片 設(shè)計和版圖設(shè)計的各種EDA工具（如：DC/Prime Time/Encounter/Virtuoso/Calibre/Dracula/Assura），具有豐富的SOC芯片設(shè)計、驗證、DFT、PD、流片經(jīng)驗。
熟練掌握版圖設(shè)計規(guī)則并進行驗證及修改；熟練掌握Unix/Linux操作系統(tǒng)；熟悉CMOS設(shè)計規(guī)則、物理設(shè)計以及芯片的生產(chǎn)流程與封裝。

【王老師】

資深I(lǐng)C工程師，十幾年集成電路IC設(shè)計經(jīng)驗，精通chip的規(guī)劃、數(shù)字layout、analog layout和特殊電路layout。先后主持和參與了近三百顆CHIP的設(shè)計與版圖Layout工作,含MCU芯片、DSP芯片、LED芯片、視頻芯片、GPU芯片、通信芯片、LCD芯片、網(wǎng)絡(luò)芯片、手機芯片等等。
從事過DAC、ADC、RF、OP、PLL、PLA、LNA、ESD、ROM、RAM等多種制程analog&digital的電路IC設(shè)計，
熟練掌握1.8V，3.3V,5V,18V,25V，40V等各種高低壓混合電路的IC設(shè)計。

【張老師】

從事數(shù)字集成電路設(shè)計10余年，精通CMOS工藝流程、版圖設(shè)計和布局布線，精通VERILOG,VHDL語言，
擅長芯片前端、后端設(shè)計和復(fù)雜項目實施的規(guī)劃管理，其領(lǐng)導(dǎo)開發(fā)的芯片已成功應(yīng)用于數(shù)個國際知名芯片廠商之產(chǎn)品中。豐富的芯片開發(fā)經(jīng)驗，對于現(xiàn)今主流工藝下的同步數(shù)字芯片設(shè)計技術(shù)和流程有良好把握。長期專注于內(nèi)存控制器等產(chǎn)品的研發(fā)，擁有數(shù)顆規(guī)模超過百萬門的數(shù)字芯片成功流片經(jīng)驗.

★更多師資力量請見曙海師資團隊。
遠程培訓(xùn)
   新優(yōu)惠
       ◆在讀學(xué)生憑學(xué)生證，可優(yōu)惠500元。

      ◆  本課程實戰(zhàn)演練使用Synopsys公司的DC,PT等工具，
和Cadence公司的Encounter,Virtuoso等工具，多工具聯(lián)合從頭至尾強化練習(xí)整個芯片的生成過程，強調(diào)實戰(zhàn)，實戰(zhàn)，還是實戰(zhàn)！

      ◆  免費、無保留贈送，教學(xué)過程中使用的Synopsys公司和Cadence公司的全套工具和安裝方法，而且還贈送已經(jīng)在VMware Linux下安裝好的Synopsys公司和Cadence公司的全套工具（這套工具非常珍貴，費了老師很多心血才全部安裝好），讓您隨時隨地，打開電腦就能進行芯片的設(shè)計和練習(xí)！
       
      ◆  贈送每個工具用到的流片廠工藝庫和技術(shù)文件。

      ◆  企業(yè)化項目管理方案。
IC工具虛擬機
   質(zhì)量保障

        1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓(xùn)班中重聽；
        2、課程完成后,授課老師留給學(xué)員手機和Email,保障培訓(xùn)效果,免費提供半年的技術(shù)支持。
        3、培訓(xùn)合格學(xué)員可享受免費推薦就業(yè)機會。
　　　　　　　　　　　　　　SOC/ASIC設(shè)計培訓(xùn)班

 
第一階段 ASIC設(shè)計

1) 邏輯設(shè)計理論/ Verilog/ VHDL語言

2) 數(shù)字電路驗證（verification平臺建立/功能測試

3) 設(shè)計綜合（synthesys）與掃描鏈測試(DFT)

4) 靜態(tài)時序分（STA）

5) 數(shù)字電路前端設(shè)計實戰(zhàn)（有兩個實際芯片項目）

理論學(xué)習(xí)之外，以實際項目讓學(xué)員接觸設(shè)計，為此提供完整的免費的EDA軟件安裝服務(wù)，并有實際芯片案例,導(dǎo)師指導(dǎo)全程設(shè)計。

數(shù)字設(shè)計的理論部分具體內(nèi)容如下:

一 邏輯設(shè)計理論/ Verilog/ VHDL語言
1 ) HDL 語言簡介
Verilog 語言的產(chǎn)生發(fā)展 優(yōu)勢和特點
編譯仿真的原理
Verilog/VHDL 語言各自現(xiàn)狀及應(yīng)用
2）verilog語法 （或者 VHDL語法 ）
模塊 時延的概念與應(yīng)用
運算符及優(yōu)先級
賦值的類型與適用
條件語句 循環(huán)語句
Initial always task function 說明語句及使用
行為級建模和可綜合設(shè)計
3）數(shù)字系統(tǒng)設(shè)計
數(shù)據(jù)流的設(shè)計/控制 時序設(shè)計
狀態(tài)機設(shè)計

二 verification平臺建立/功能測試
1） 驗證環(huán)節(jié)在ic設(shè)計流程中的位置，
2) RTL/網(wǎng)表/FPGA/testchip 的驗證階段
3) 驗證計劃
4)　verification 的方法學(xué)　種類和適用設(shè)計
5) 　RTL verification testbench setup 激勵文件生成　
6) 　RTL語言和高級語言的混合驗證平臺建立
7) 　數(shù)模混合設(shè)計驗證方法學(xué)

三 設(shè)計綜合（synthesys）與掃描鏈測試(DFT)
1）綜合
綜合的概念　
綜合庫與工具介紹　
綜合的過程　
約束／工作環(huán)境的設(shè)立　
反標文件產(chǎn)生
優(yōu)化設(shè)計
2）DFT
DFT 概念
scan chain/ BSD/BIST　概念與設(shè)計方法
DFT 的測試原理/測試方法( D算法　向量產(chǎn)生與仿真)
BSD 基本單元和JTAG測試　

　
四　靜態(tài)時序分（STA）

1)靜態(tài)時序分析概念
2)數(shù)據(jù)延遲　setup /hold 的分析
3)時鐘結(jié)構(gòu) 跨時鐘／多時鐘條件　
4)端口約束／工作環(huán)境設(shè)定
5)工作條件／工藝條件　對延遲的影響
6)關(guān)鍵路徑與設(shè)計優(yōu)化　
7)報告分析　

五 實踐項目部分
項目一: RTL coding
中斷管理狀態(tài)機設(shè)計
驗證平臺設(shè)計和使用
測試向量設(shè)計
驗證工具的使用
debug 調(diào)試
項目二: 基礎(chǔ)通信協(xié)議
方案設(shè)計
RTL coding
通信算法的運用
CPU控制
FIFO設(shè)計與實現(xiàn)
驗證平臺設(shè)計和使用
測試向量設(shè)計
驗證工具的使用
debug 調(diào)試
電路綜合和DFT
靜態(tài)時序分析
第二階段 SOC


1.架構(gòu)及設(shè)計流程
2.CPU核
1）指令
2）中斷和異常
3）數(shù)據(jù)緩沖和指令緩沖
4）內(nèi)部數(shù)據(jù)ram和指令RAM
3.AMBA總線
4.外設(shè)
1）SRAM
2)DRAM
3)IO
4)DMA

5.項目實戰(zhàn)
設(shè)計ARM
曙海教育實驗設(shè)備
fpga培訓(xùn)實驗板
fpga培訓(xùn)實驗
fpga圖像處理
曙海培訓(xùn)實驗設(shè)備
fpga培訓(xùn)班
 
本課程部分實驗室實景
曙海實驗室
實驗室
曙海培訓(xùn)
曙海培訓(xùn)優(yōu)勢
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上海總部培訓(xùn)基地

地址：上海市云屏路1399號26#新城金郡商務(wù)樓310。
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.(2014年7月11).....直播、現(xiàn)場培訓(xùn)........................................................

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